Страница: 2/8
· блок микропрограмного управління (БМУ);
· блок приоритетів переривань (БПП);
· блок синхронізації (БС);
· схема обміну інформації (СОІ);
· оперативний запам`ятовуючий пристрій (ОЗП);
· зовнішні пристрої (
-
).
Структурна схема мікро-ЕОМ представляє загальний принцип роботи всієї мікро-ЕОМ.
ОП виповнює обробку данних, поступаючих до нього, забезпечує зберігання та видачу признаків результатів, отриманих в ОП, формування слова стану.
БМУ забеспечує прийняття виконуваної команди із ОЗП, преобразування кода команди для подальшого обчислювання, виробка адреси мікрокоманди для пам`яті мікропрограм, формування необхідного формату мікрокоманди для керування БІСами ЕОМ, а також забеспечує перехід на мікропрограму-відробник вектору переривання, адреса якого надходить з блоку БПП.
БПП забеспечує прийняття запросів від зовнішніх пристроїв, керування приоритетами ліній переривань, формування вектора переривання та по цьому вектору формування адреси відробнику переривання для БМУ.
В ОЗП зберігаються команди, які необхідно виконувати на даній мікро-ЕОМ, причому записані у системі ЕС ЕОМ, систему команд якої емулює розроблена мікро-ЕОМ.
БС забеспечує усі схеми ЕОМ стабільними тактовими послідовностями, формірує машинні цикли для БІС.
В загальному виді мікро ЕОМ функціонує слідуючим образом: Виконувана команда зчитується з ОЗП та попадає на БМУ. БМУ преобразує код команди та починає виконання мікропрограми обробки поданої мікрокоманди. Під час виконування мвкрокоманд БМУ програмує мікропроцесорний комплект на виконання конкретних операцій згідно алгоритму. Якщо у час виконання програми надходить переривання від зовнішнього пристрою, БПП формує запит на переривання та адресу обробника переривання, та БМУ починає обробку переривання.
4. Функціональна схема микро-ЕОМ
4.1 Арифметико логічний пристрій
Арифметико-логічний пристрій (АЛП) призначено для виконання арифметичних і логічних операцій, операнди для яких або безпосередньо надходять із шини даних (ШД), або читаються з внутрішнього реєстрового запам'ятовуючого пристрою (РЗП) АЛП, адреса для який надходить зі ШД. АЛП містить:
шістнадцять центральних процесорних елемента (ЦПЕ) К1804ВР2;
контролер станів К1804ВР2;
схема прискореного переносу К1804ВР1;
БІС К1804ВР2 являє собою 4-розрядну нарощувану мікропроцесорну секцію (МПС) з підвищеними алгоритмічними можливостями й орієнтована на обробку складних арифметичних алгоритмів. Володіючи секционированной структурою, даний ЦПЕ дозволяє за рахунок об'єднання декількох БІС будувати процесори (чи АЛП) довільної розрядності, кратної 4.
Дана МПС керується кодом мікрокоманди, поданим на входи I0-I8, у залежності від значення якого БІС вибирає джерела операндв, виконувану над ними операцію і приймач результату цієї операції.
БІС К1804ВР2 призначена для замикання даних навколо МПС К1804ВР2 при побудові АЛП мікро-ЕОМ, забезпечуючи також функції регістра стану і формірователя сигналу переносу.
Під впливом зовнішніх сигналів управління дана БІС формує сигнали для організації зрушень і переносів в АЛП, а також, обробляючи ознаки стану, що надходять з АЛП блоку обробки даних:
перенос (C);
нульовий результат (Z);
знак результату (N);
переповнення (OVR),
формує сигнал умови для організації розгалужень як у програмах, так і в мікропрограмах.
Для порівняння двох чисел необхідно подать ці числа на АЛП, організувати їхнє вирахування, а на шину управління БІС К1804ВР2 подать команду порівняння по необхідній умові. Після чого КС за значенням C, Z, N, OVR сформує на виході CT сигнал низького рівня, якщо задана умова виконується, чи сигнал високого рівня, якщо воно не виконується.
Реферат опубликован: 24/12/2007